請高手解答 題目：試編寫「01111110」序列發生器的vhdl語言程式
1樓：網友
這涉及到序列訊號發生器的問題，多少會跟通訊原理悉枯中有關，用狀態轉移圖即可實現。
用vhdl描述也可，方敗旁法有很多，比如計數器 狀態機等等吧，需要的話留個q
希望睜山能幫到你。
用vhdl語言編寫正弦波發生器（編譯通過的）
2樓：網友
用matlab產生1個週期的值，通過dat或mif檔案匯入block ram，然後讀這個block ram就好了。
或者用泰勒函式在vhdl裡直接產生這些值，匯入block ram
3樓：手機使用者
樣的），還沒除錯。你可以到圖書館找本vhdl設計的書，大部分書上都有函式發生器的例子的源程式的。是在你找不到，我也可以發給你，不過你可能看不太懂，最好借本書大概看下。
這個算是比較簡單的東西。
已傳送！！！
請使用verilog或者vhdl設計乙個序列發生器。
4樓：網友
輸出4個1及以上，檢測位為1，否則為0?只要128—255的個數4個以上就一直是1麼？
求一序列訊號發生器vhdl程式，要有000～111，8種情況出現
5樓：fpga_cpld_大神
要求偽隨機的還是，固定的，可以使用偽隨機產生器，自己編寫表示式。
**的高手能給我個dds訊號發生器vhdl語言的程式啊～～
6樓：網友
跟我的題目一樣，當然我是用verilog寫的。
很簡單，先用c產生mif檔案，然後匯入到quartusii裡面，呼叫裡面的巨集功能模組，不用定**就能搞定，當然具體的方法也不是兩三句能說得明白的，你可在上面的文庫裡面搜dds，人家有**你可參考！有問題咱們可交流一下哦。
7樓：網友
dds都有現成的ipcore可以呼叫啊！
01111110序列訊號檢測器的vhdl狀態機，狀態轉換表為什麼是這樣的，看不懂，求大神解答
8樓：網友
狀態含義：s0: reset
s1: got0
s2: got01
s3: got011
s4: got0111
s5: got01111
s6: got011111
s7: got0111111
s8: got01111110 此時檢測到序列01111110 輸出為1，其餘輸出都為0
很明顯，在s1 s2 s3 s4 s5 s6 s7 如果輸入為0，都會退回到s1(got0)
急求c語言高手解答題目詳細說明最好
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