1樓：
不是。應該是當d1等於1即為真時led_5賦值為1，d1等於0即為假時led_5賦值為0
2樓：匿名使用者
不。該句話意思是：
如果d1值為真，即d1非零，則 led_d5取1'b1（一位二進位制數1）值，若d1為零，則led_d5取1'b0（一位二進位制數0）值
3樓：匿名使用者
不是，應該是這樣的a=(b)?1'b0:1'b0;
當b為真時a為1，b為假時a為0.
.^ 在verilog 是什麼運算子，怎麼運用？
4樓：匿名使用者
verilog裡只有^運算子，表示異或，沒有.^
.^ 是matlab裡的運算子，叫陣列冪
5樓：匿名使用者
異或運算，雙目操作符，例如 out=a^b; 表示：out等於a與b的異或，即僅當a與b不等時out才為1，其他情況為0。
6樓：tn瓶邪
assign icoef=},coef}
這裡來是自取了codf的某一位，
baicwidth-1能算出一個值
du來吧。
}這裡是對coef中的那一位進行了mwidth-cwidth次的重zhi復
最後dao在拼接coef的所有位.
7樓：匿名使用者
verilog 是一種硬體編譯語言，不是運算子號！在晶片**商提供的軟體裡面編寫。
verilog拼接符的用法
8樓：冰凍了你呢
在verilog hdl語言有一個特殊的運算子
：位拼接運算子{}，用這個運算子可以把兩個或多個訊號的某些位拼接起來進行運算操作。其使用方法如下:
即把某些倍號的某些位詳細地列出來，中間用逗號分開，最後用大括號括起來表示一個整體訊號，例如：
也可以寫成為：
在位拼接表示式中不允許存在沒有指明位數的訊號。這是因為在計算拼接訊號的位寬的大小時必需知道其中每個訊號的位寬。
位拼接也可以用重複法來簡化表示式，如下所示：
位拼接還可以用巢狀的方式來表達，如下所示：
【拓展資料】
verilog hdl的語言的運算子的範圍很廣，按照其功能大概可以分為以下幾類:
(1)算術運算子 +，-，*，/，%
(2)賦值運算子 =，<=
(3)關係運算子》 ,<,>=,<=
(4)邏輯運算子 &&, ||, !
(5)條件運算子 ？：
(6)位運算子 ~, | , ^ ,& ,^~
(7)移位運算子 << ,>>
(8)拼接運算子 {}
(9)其他。
1）基本的算術運算子：加減乘都比較簡單這裡不再記錄。
在進行整數的除法運算時，結果要略去小數部分，只取整數部分；而進行取模運算時（%，亦稱作求餘運算子）結果的符號位採用模運算子中第一個運算元的符號。
-10%3 結果 -1 11%-3 結果為2
注意：在進行算術運算時，如果某一個運算元有不確定的值x，則整個結果也為不確定值x。
2）位運算子：
按位取反~ 、按位與 & 、按位或 | 、按位異或 ^ 、按位同或 ^~
在不同長度的資料進行位運算時，系統會自動的將兩個數右端對齊，位數少的運算元會在相應的高位補0，一時的兩個運算元按位進行操作。
3）邏輯運算子：
邏輯與 &&、邏輯或 ||、邏輯非 ！
其中&&和||是雙目運算子，其優先順序別低於關係運算子，而 ！高於算術運算子。
4）關係運算子
< 、 > 、 <= 、 >= 如果關係運算是假的，則返回值是0，如果宣告的關係是真的，則返回值是1。 關係運算子的優先順序別低於算數運算子。
如: aa<(size-1) //
size-1size-(15）等式運算子
== 、！= 、===、！== 符號之間不能有空格。
「==」和「！=」稱作邏輯等式運算子，其結果由兩個運算元的值決定。由於運算元可能是x或z，其結果可能為x；
「===」和「！==」常用於case表示式的判別，又稱作cae等式運算子。其結果只為0和1.如果運算元中存在x和z，那麼運算元必須完全相同結果才為1，否則為0.
邏輯等式運算子和case等式運算子的區別：
6)移位運算子
<< 、 >> a>>n其中a代表要進行移位的運算元，n代表要移幾位。這兩種移位運算都用0來填補移出的空位。
如果運算元已經定義了位寬，則進行移位後運算元改變，但是其位寬不變。
/*不懂之處;（夏宇聞第三版，p41）
4'b1001<<1=5'b10010; 4'b1001<<2=6'b100100; (左移會使得位數增加？)
1<<6=32'b1000000; 4'b1001>>1=4'b0100; (右移不會改變位數？)
4『b1001>>4=4'b0000；
*/7）位拼接運算子
將某些訊號的某些為列出來，中間用逗號分開，最後用大括號括起來表示一個整體的訊號。
在位拼接的表示式中不允許存在沒有指明位數的訊號。
//等同於
} //等同於
}} //等同於 這裡面的3、4必須是常量表示式。
8）縮減運算子
這是單目運算子，也包括與、或、非運算。運算規則與位運算相似，不過是對單個運算子的每一位逐步運算，最後的運算結果是一位的二進位制數。
c=&b; //意思同
9樓：匿名使用者
se0是最高位，se3為最低位
當se0=1時，z=d
當se1=1時，z=c
當se2=1時，z=b
當se3=1時，z=a
優先順序se0 > se1 > se2 > se3也就是說只要se0 = 1， z就等於d。即 > =4'b1000,z等於d
依次類推
10樓：匿名使用者
關於verilog的**規範，可關注fpga-engineer公號，你會學到很多關於fpga開發的東西。
11樓：匿名使用者
ca*** ()
順序就是按照從高到低的。
第一個條件是說：當se0=1時z=d
verilog 位拼接運算子{}怎麼用的啊?
12樓：
你仔細看下就明bai白了du
assign icoef=},coef}
這裡是取了zhicodf的某一位，cwidth-1能算出一個值來吧dao。
}這裡是對coef中的回
那一位進行答了mwidth-cwidth次的重複最後在拼接coef的所有位
其實你用$display看看結果就知道了
13樓：匿名使用者
assign icoef=},coef}
這裡是取了baicodf的某一位du，zhicwidth-1能算出一個值dao來吧。
}這裡是對coef中的那一位進行了mwidth-cwidth次的重內復
最後在拼容接coef的所有位
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z x 1 y 1,y x 5 x 7,y 3 這句主要的有 du2個運zhi算符 dao,一個條件運算子 一個賦內值運算子 z 優先順序是條件運算子比容較高,可以轉換成 z x 1 y 1,y x 5 x 7,y 3 條件運算子 計算 前面表示式,為真返回冒號前面的,為假返回冒號後面的。因為 x ...
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是左移運算子號，是把運算元看成二進位制數，然後左移指定的位數，生成新的值 而c 標準庫的stream類過載了 運算子，使之成為流的輸出符號 和 賦值運算子 沒有關係 為賦值，從右向左 為整型資料的左移位，為位運算子，至於輸出流的插入符為該運算子在ostream中過載後的結果 a 是返回一個引用,主要...
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