如何用verilog程式中的測試模組進行測試

2022-11-26 02:05:13 字數 1488 閱讀 7379

1樓:匿名使用者

也算系統程式的一種吧.

如何用verilog程式中的測試模組進行測試?

quartus ii 中如何通過verilog編寫測試檔案

2樓:匿名使用者

是的從9.0?以後的版本開始 quartus去掉了波形檔案 所以只能用第三方軟體

而且很多時候用第三方軟體更方便。。。

至於怎麼一起用, 網上找找的話有解釋滴。。。。

3樓:du瓶邪

要把測試程式寫在源程式中吧,我在cadence中使用verilog時就是這樣的,不知道是軟體問題還是語言問題,因為有的軟體不用的.

在maxplusii中輸入訊號可以手動設定的,測試程式不可以的話手動好了.

用verilog語言設計時,有頂層模組,沒有加入測試程式時可以綜合,可加入測試程式後,再重新開啟就

4樓:

1全部首先測試檔案對你頂層檔案是沒有影響的,因為測試檔案是不可綜合的而且是.vt格式的檔案估計是你**設定出錯了吧或者你的測試檔案定義的不是針對頂層檔案而寫的,這是工具會報錯,因為介面對不上,另外也可能是你的hdl語言用了不可綜合子集,具體什麼原因你把**附上在分析吧,以上有什麼問題可以繼續追問

5樓:匿名使用者

這個並沒有規定,測試多個模組是可以的,封裝成一個模組,在進行測試也是可以你可以先對每個模組都寫一個測試檔案進行測試,然後寫個頂層檔案將所有模組都z

6樓:匿名使用者

不能綜合就是有錯誤啊,比如貌似task是不可綜合的吧,其他目前還不知道。先將測試程式置為頂層檔案,綜合通過,應該就沒有問題了

如何使用verilog hdl 中的測試程式。。。·include"count4.v"這句老是報錯,, 5

7樓:匿名使用者

路徑沒寫好吧 一般在做verilog**測試時,**檔案放到rtl資料夾 測試檔案放到sim資料夾,工作建個資料夾working emacs寫個filelist 把需要用到的檔案.v test.v 寫進去 run下就可以了

這樣就不會造成檔案亂七八糟的情況 重複錄入等的麻煩

8樓:空心蘿布

有兩個模組名字都是count4

9樓:匿名使用者

最好把**附上來看看吧

verilog中initial語句只能用於對測試模組的描述,為什麼? 5

在quartusii中用verilog寫程式,怎麼使用 測試模組?還是說得用其他軟體?

10樓:

timescale前面應該是`(數字鍵最左面的符號)而不是'

include也是同樣的問題。符號不對

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